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時間：2023-03-13

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如何提升PLC網(wǎng)絡(luò)能與優(yōu)化方法

1.網(wǎng)絡(luò)參數(shù)的設(shè)置

波特率和主站數(shù)是影響網(wǎng)絡(luò)能的兩個主要因素。選擇所有設(shè)備支持的高波特率進行通信會得到佳的通信效果,網(wǎng)絡(luò)中的主站會增加網(wǎng)絡(luò)的負載,減少網(wǎng)絡(luò)中的主站數(shù)目可以提高網(wǎng)絡(luò)能。

各主站的地址應(yīng)連續(xù)排列,如果主站間的地址有向隙，主站將不斷地檢春間隙中的地址，確定是否有其他主站等待進入連接。這種檢查需要時間,會增加網(wǎng)絡(luò)的負載。如果主站之間沒有問隙,就不需要進行這種檢查。

如果從站地址在主站地址之間,會造成主站之間的地址問隙,增加網(wǎng)絡(luò)的負載。

當CPU作為PPI主站時,可以在STEP7-Miero/WIN 32系統(tǒng)塊的通信標簽中設(shè)置向除刷新因子(GUF)和高站地址。CUF用來確定檢查地址間隙的時間間隔。GUF=1表示每次占有令牌時都要檢查地址間院,GUF-2表示每兩次占有令牌檢查一次地址間隙。如果主站之間有地址間隙,設(shè)置高的GUF可以降低網(wǎng)絡(luò)負載。如果主站間沒有間隙,GUF不影響網(wǎng)絡(luò)能。GUF過大會使主站網(wǎng)絡(luò)通信時有較長的延遲。

高站地址(HSA)定義了一個主站尋找其他主站的高地址。合理設(shè)置的HSA可以減少尋找和連接另一個主站所需要的時間。高站對于從站沒有影響，主站仍然可以與地址大于HSA的從站通信。

應(yīng)在所有的主站上設(shè)置相同的高站地址,這個地址應(yīng)大于或等于系統(tǒng)中的高站地址，HSA的缺省值是31。

2.令牌循環(huán)時間

在令牌循環(huán)網(wǎng)絡(luò)中,只有擁有令牌的站有初始化通信的權(quán)力。令牌循環(huán)時問是將令牌傳送到邏輯環(huán)中所有主站(令牌擁有者)所需的時間。對于象PPI這樣的令牌傳送網(wǎng)絡(luò),令牌循環(huán)時間是個很重要的參數(shù)。

設(shè)網(wǎng)絡(luò)中4個S7-200CPU模塊的站地址分別為2、4、6、8.每一個都有自己的TD 200,其站地址分別為3、5、7、9,僅站2和站4為從站，其余的均為主站，兩個CPU224模塊收集來自其他所有CPU模塊的數(shù)據(jù)。

主站要發(fā)送信息,必須持有令牌。例如當站3持有令牌時,它初始化到站2的請求,然后把令牌傳給站5,站5才能初始化到站4的請求信息,然后把令牌傳給站6,站6再初始化到站2.4或8的請求信息,然后把令牌傳給站7。這個初始化信息和傳送令牌的過程會在邏輯環(huán)中持續(xù)進行,從站3到站5,又到站6、7、8、9后又返回站3。為了使主機能發(fā)出請求信息,這個今牌必須在邏輯環(huán)中完整循環(huán)。

如果允許PPI主站模式(在網(wǎng)絡(luò)中使用PPI協(xié)議),CPU用網(wǎng)絡(luò)讀(NETR)和網(wǎng)絡(luò)寫(NETW)指令與其他CPU交換信息。如果下列設(shè)成立,令牌循環(huán)時間可由式(7-1)和式(7-2)近似求出：

(1)各站占有令牌時發(fā)送一個請求。

(2)請求讀或?qū)懙臄?shù)據(jù)的地址是連續(xù)的。

(3)CPU的通信緩沖區(qū)的使用沒有沖突。

(4)CPU的掃描時間都不過10ms。

令牌占用時間Thold=(128 n)宇符x11bit/字符x1/波特率 (7-1)

令牌循環(huán)時間Trot=主站1的Thold 主站2的Thold … 主站m的Thold (7-2)

式中128為附加字符數(shù)，n為數(shù)據(jù)字符的字節(jié)數(shù),每個字符11位,m為主站的個數(shù)。

設(shè)上例中6個主站均發(fā)送一個雙字的請求信息,各主站的令牌占用時間均為Thold =(128 4)字符x11bit/字符x1/9600 bit/s=151.25ms。令牌循環(huán)時間To=Thld x6=151.25 x 6ms= 907.5 ms。

6ES7211-1BE40-0XB0	CPU 1211C AC/DC/Rly,6輸入/4輸出,集成2AI
6ES7211-1AE40-0XB0	CPU 1211C DC/DC/DC,6輸入/4輸出,集成2AI
6ES7211-1HE40-0XB0	CPU 1211C DC/DC/Rly,6輸入/4輸出,集成2AI
6ES7212-1BE40-0XB0	CPU 1212C AC/DC/Rly,8輸入/6輸出,集成2AI
6ES7212-1AE40-0XB0	CPU 1212C DC/DC/DC,8輸入/6輸出,集成2AI
6ES7212-1HE40-0XB0	CPU 1212C DC/DC/Rly,8輸入/6輸出,集成2AI
6ES7214-1BG40-0XB0	CPU 1214C AC/DC/Rly,14輸入/10輸出,集成2AI
6ES7214-1AG40-0XB0	CPU 1214C DC/DC/DC,14輸入/10輸出,集成2AI
6ES7214-1HG40-0XB0	CPU 1214C DC/DC/Rly,14輸入/10輸出,集成2AI
6ES7215-1BG40-0XB0	CPU 1215C AC/DC/Rly,14輸入/10輸出,集成2AI/2AO
6ES7215-1AG40-0XB0	CPU 1215C DC/DC/DC,14輸入/10輸出,集成2AI/2AO
6ES7215-1HG40-0XB0	CPU 1215C DC/DC/Rly,14輸入/10輸出,集成2AI/2AO
6ES72171AG400XB0	CPU 1217C DC/DC/DC,14輸入/10輸出,集成2AI/2AO

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